Puntuación:
El libro es muy recomendable para los ingenieros que pasen de Verilog a SystemVerilog, sobre todo con fines de diseño. Es detallado, fácil de leer y está bien estructurado. Sin embargo, cabe señalar que la edición Kindle tiene un formato deficiente, y algunos usuarios opinan que carece de una cobertura exhaustiva del lenguaje SystemVerilog y tiene un índice escaso.
Ventajas:⬤ Excelente para ingenieros familiarizados con Verilog en transición a SystemVerilog, en particular para el diseño.
⬤ Detallado pero fácil de leer.
⬤ Proporciona buenos ejemplos y casos de estudio.
⬤ Temas bien estructurados que fluyen lógicamente.
⬤ Recomendado para diseñadores y arquitectos RTL.
⬤ Problemas de formato en la edición Kindle.
⬤ No es exhaustivo; carece de detalles sobre todo el lenguaje SystemVerilog.
⬤ Índice escaso en comparación con otros libros de texto.
⬤ Se centra principalmente en las características sintetizables, no cubre los aspectos no sintetizables.
(basado en 14 opiniones de lectores)
Systemverilog for Design Second Edition: A Guide to Using Systemverilog for Hardware Design and Modeling
En su segunda edición actualizada, este libro se ha revisado exhaustivamente capítulo por capítulo para incluir las numerosas actualizaciones de texto y ejemplos necesarias para reflejar los cambios adoptados entre la primera edición del libro y la finalización del nuevo estándar.
El libro refleja con precisión los cambios sintácticos y semánticos del lenguaje SystemVerilog, lo que lo convierte en una referencia esencial para los profesionales de sistemas que necesiten información sobre la última versión. Además, la segunda edición incluye un nuevo capítulo que explica los «paquetes» de SystemVerilog, un nuevo apéndice que resume las directrices de síntesis presentadas a lo largo del libro, y todos los ejemplos de código se han actualizado a la sintaxis final y se han vuelto a ejecutar utilizando la última versión de las herramientas de Synopsys, Mentor y Cadance.
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Última modificación: 2024.11.14 07:32 (GMT)